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[Zeroplus LAP-F14064M] 40Ch, 64M(40Ch)~1Gb(1Ch), 1GHz USB Logic Analyzer, 로직아날라이저, 로직분석기

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기본 정보
상품명 [Zeroplus LAP-F14064M] 40Ch, 64M(40Ch)~1Gb(1Ch), 1GHz USB Logic Analyzer, 로직아날라이저, 로직분석기
상품간략설명 40ch 64Mb Logic Analyzer
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제조사 ZEROPLUS
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상품요약정보 40ch 64Mb Logic Analyzer
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LAP-F1404M,LAP-F1408M,LAP-F14016M,LAP-F14032M,LAP-F14064M


LAP-F140XXM (40CH) Logic Analyzer with Protocol Analysis

 

고속(high Speed), 다양한 측정, 무상(Free) 110protocol 분석

 

 자일링스(Xilinx) 고성능 FPGA 칩 및 아주 뛰어난 Active probe를 이용한 측정으로 샘플링 정확도 및 안정성 높임.

 샘플링율 (State Mode) : Max 200MHz

 샘플링율 (Timing Mode) : Max 1GHz

 채널수 : 40Ch

 하드웨어적 6종 프로토콜 트리거 (I2C,I2S,SPI,SVID,UART,CAN2.0B)


 eMMC5.1/SD3.0 LA mode _ protocol decoder and Trigger (옵션)


 Long time record (옵션) – 7시간부터 약 30일정도 저장 가능


Sampling rate

 

Internal (Timing)(Asynchronous) max. 1 GHz
External (State)(Synchronous) max. 200 MHz (Dual-edge)

 

 

Active probes / Signals

 

P100ST (기본제공)
P120LV (Optional)
P120NE (Optional)
P200EM (4 probes _
기본제공)

 

Model / Memory

 

모델명 / (채널당 메모리)

LAP-F1404M(4Mb),

LAP-F1408M(8Mb)

LAP-F14016M( 16Mb)

LAP-F14032M( 32Mb )

LAP-F14064M( 64Mb )

 

 

Trigger

 

6 protocol triggers (hardware)(serial): I2C, I2S, SPI, SVID, UART (RS-232C/422/485), CAN 2.0B
Trigger types: Pattern/Edge/Pulse Width/Interval (Time)
Trigger channels: 40
Trigger delay: Yes
Trigger levels: 256
Trigger pass: 1-65535

 

 

Operating system

 

Windows 8.1/ win10

 

 

Data transmission

 

USB 3.0 (compatible with 2.0)

 

 

Special software features

 

Zooming and panning
Waveform and UI Customization
State list and Waveform view
Packet list
Waveform Navigator
Memory view
Statistic
File Comparison

 

 

Phase error

 

< 3 ns

 

 

Power supply

 

AC (IN): 100~240V, 50~60Hz
DC (OUT): 9V/5.55A

 

 

Certifications

 

FCC / CE

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